ID articolo: 000086977 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 04/11/2013

Aggiornamento delle specifiche della frequenza massima EMIF per Stratix V

Ambiente

  • Intel® Quartus® II (in abbonamento)
  • Simulazione
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT

    Problema critico

    Descrizione

    Questo problema riguarda i prodotti DDR2 e DDR3.

    Le interfacce DDR2 e DDR3 sui dispositivi Stratix V potrebbero avere difficoltà raggiungere la chiusura dei tempi a determinate frequenze massime.

    Risoluzione

    La soluzione per questo problema consiste nell'applicare la soluzione appropriata soluzione per la configurazione come descritto di seguito:

    • Per velocità Stratix V, -C1/-C2 interfacciamento del dispositivo con un DIMM SDRAM DDR2 in un dual slot quad-rank configurazione, utilizzando un controller soft a mezza velocità e una frequenza specifiche di 400 MHz: Aggiornare il componente SDRAM DDR2 a 400 MHz a un componente SDRAM DDR2 a 533 MHz per raggiungere la frequenza massima specificata.
    • Per Stratix interfaccia del dispositivo con velocità V, -C1/-C2 con un componente SDRAM DDR2 in una configurazione di selezione a 2 chip, utilizzando controller soft a mezza velocità e una specifica di frequenza di 400 Mhz: Aggiornare il componente SDRAM DDR2 a 400 MHz a un componente SDRAM DDR2 a 533 MHz per raggiungere la frequenza massima specificata.

    Questo problema non verrà risolto.

    Le soluzioni per le specifiche di massima frequenza saranno aggiornato in una versione futura della specifica dell'interfaccia di memoria esterna Estimatore.

    Prodotti correlati

    Questo articolo si applica a 2 prodotti

    FPGA e FPGA SoC Arria® V
    FPGA e FPGA SoC Cyclone® V

    Disclaimer

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