ID articolo: 000084996 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 01/10/2013

Linee guida per la connessione dei pin della famiglia di dispositivi Cyclone IV: problemi noti

Ambiente

BUILT IN - ARTICLE INTRO SECOND COMPONENT
Descrizione

Problema 137246: Versione 1.5

Se le connessioni JTAG non vengono utilizzate, è necessario collegare il pin TCK a GND, TDI e TMS a VCCA e lasciare TDO scollegato.

Numero 77849: Versione 1.4

I dispositivi Cyclone IV E non hanno un pin di clock dedicato CLK0. Vengono forniti fino a 15 pin di clock dedicati (CLK[15..1]).

Numero 59732: Versione 1.4

DATA0 e DATA1 sono indicati come "open drain bidirezionale", ma questo non è corretto e verrà corretto per indicare che sono solo "bidirezionale".

Problema 382585, versione 1.4

La nota 2 non elenca tutte le tensioni VCC_CLKIN disponibili per le banche 3B e 8B.  La versione 1.4 elenca solo 2,5 V, ma 1,2V, 1,5V, 1,8V, 2,5V, 3,0V e 3,3 V sono tutte tensioni supportate per VCC_CLKIN su banche 3B e 8B.

Numero 66844, Versione 1.4

Per il pin CRC_ERROR la nota 24 verrà rimossa poiché non ha alcuna relazione con il pin CRC_ERROR.

La descrizione del pin verrà inoltre aggiornata per riflettere che il pin CRC_ERROR è sempre un pin a scarico aperto se utilizzato come pin CRC_ERROR e non è un output dedicato in cui è possibile attivare il pin CRC_ERROR come un pin aperto nella scheda rilevamento CRC_ERROR della finestra di dialogo Opzioni dispositivo e pin .

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Questo articolo si applica a 2 prodotti

FPGA Cyclone® IV E
FPGA Cyclone® IV GX

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