ID articolo: 000083947 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 08/11/2019

Perché il design di esempio OpenCL™ "Compute Score" è appeso al Intel® Programmable Acceleration Card D5005?

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    Se si esegue la progettazione dell'esempio OpenCL™ "compure_score" sul Intel® Programmable Acceleration Card D5005, è possibile che il design di esempio si blocchi e non producano risultati.  Si potrebbe vedere qualcosa di simile a quanto segue:

    [root@localhost bin]# ./host

    RAND_MAX: 2147483647

    Allocazione e impostazione dei dati

    Creazione di documenti total_terms=108157184 (no_pad=91552735)

    Creazione di un profilo

    ...

    Configurazione di OpenCL

    Piattaforma: Intel® FPGA SDK per OpenCL™

    Utilizzo di 1 dispositivo

    pac_s10_dc: piattaforma Intel PAC (pac_ee00000)

    Utilizzo di AOCX: compute_score.aocx

    Tempo di compilazione del kernel: 0.016351 ms

    .......................................... rimanere qui e non può ottenere risultati..................................

     

    Ciò è dovuto al fatto che la compilazione della riconfigurazione parziale (PR) utilizzando OpenCL™ può produrre violazioni del tempo di attesa nelle regioni statiche. È possibile trovare i file "afu_default.failing_clocks.rpt/afu_default.failing_paths.rpt" nella cartella di output.

    Risoluzione

    Per risolvere questo problema, è necessario ricompilarlo utilizzando un seed diverso con il comando: aoc -seed=. Ad esempio: aoc hello_world.cl -seed=5.

    Questo problema è pianificato per essere risolto in una versione futura dello stack di accelerazione Intel® per Intel Xeon® CPU con FPGAs.
     

    Prodotti correlati

    Questo articolo si applica a 2 prodotti

    Intel® FPGA PAC D5005
    FPGA SoC Intel® Stratix® 10 SX

    Disclaimer

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