ID articolo: 000080329 Tipo di contenuto: Messaggi di errore Ultima recensione: 07/11/2014

Errore (21180): impossibile trovare le impostazioni legali per il nodo PLL "interlaken_inst|sv_pma:inst_sv_pma|sv_rx_pma:rx_pma.sv_rx_pma_inst|rx_pmas[0].rx_pma.rx_cdr" con frequenza di clock di riferimento "500,0 MHz" e frequenza di clock ...

Ambiente

  • Intel® Quartus® II (in abbonamento)
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    A causa di un bug nel software Quartus® II versione 14.0, potrebbe essere visualizzato l'errore Fitter sopra durante la compilazione dell'IP Seriallite III per i dispositivi Stratix® V utilizzando un datarate di 12,5 Gbps e una frequenza di clock di riferimento ricetrasmettitore a 500 MHz.

    Risoluzione

    È possibile estrarre i seguenti parametri dal file RTL di primo livello IP Seriallite III 13.1.4 e trasferirli alla versione IP Seriallite III 14.0.
                                                                           
    reference_clock_frequency => "312,500000 MHz",
    pll_ref_freq => "500,0 MHz",
    data_rate => "12500,00000 Mbps"

    Altre combinazioni di frequenze REFCLK di datarate e ricetrasmettitori per l'IP Seriallite III possono anche produrre l'errore fitter sopra.  La stessa soluzione può essere applicata estraendo i parametri dalla versione 13.1.4 e trasferendoli alla versione IP Seriallite III 14.0.                                                                                             
                                                                           
    Questo è previsto per essere risolto in una versione futura del software Quartus II.

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    Questo articolo si applica a 1 prodotti

    FPGA Stratix® V GX

    Disclaimer

    1

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