ID articolo: 000077400 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 12/08/2019

Perché le impostazioni di equalizzazione PHY IP TX nativo di Intel® Stratix® 10 dispositivi non corrispondono a ciò che viene letto dal registro degli attributi PMA o a ciò che viene visualizzato nel toolkit di ricetrasmettitore software In...

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • PHY nativo ricetrasmettitore E-Tile Stratix® 10
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    A causa di un problema in Intel® Quartus® Prime Software versione 19.2 e versioni precedenti, le impostazioni di equalizzazione PHY native PHY TX definite dall'utente Stratix 10 dispositivi potrebbero non essere correttamente incorporate nel file di programmazione <project_name>.sof.

    Le seguenti condizioni potrebbero far sì che le impostazioni di equalizzazione TX non vengano scritte nel file <project_name>.sof

    • Attenuazione non supportata, Pre-tap 1, Pre-tap 2, Pre-tap 3 o Post-tap 1 equalizzazione impostazioni.
    • Valore ATTEN diverso da zero.

    Le impostazioni di equalizzazione lette dal registro degli attributi PMA o visualizzate nell'Intel Quartus Prime Transceiver Toolkit rappresentano le impostazioni di equalizzazione effettive nella PHY.

    Soluzione

    Per risolvere questo problema, fare riferimento alla guida dell'utente del ricetrasmettitore E-Tile PHY e inserire solo le impostazioni di equalizzazione TX supportate nell'IP PHY PHY nativo di E-Tile.

    Se si desidera utilizzare impostazioni di equalizzazione TX non zero, scrivere al PHY utilizzando i codici di attributo PMA dopo la configurazione FPGA.

    Questo problema è stato risolto in Intel® Quartus® versione del software 19.3

    Prodotti correlati

    Questo articolo si applica a 2 prodotti

    FPGA Intel® Stratix® 10 TX
    FPGA Intel® Stratix® 10 MX

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