ID articolo: 000075391 Tipo di contenuto: Installazione e configurazione Ultima recensione: 09/06/2017

Perché l'elaborazione dell'IP JESD204B Nios esempio di progettazione del controllo non riesce, con un'impostazione L=1?

Ambiente

  • Intel® Quartus® Prime Standard Edition
  • Intel® FPGA IP JESD204B
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    L'elaborazione di un Arria® 10 JESD204B Nios esempio di progettazione del controllo con L=1 potrebbe fallire in Quartus® Prime Standard versione 17.0 a causa di un problema con l'interconnessione Qsys con l'interfaccia reconfig_*, con conseguente mancata generazione dei file di codice sorgente da parte di Qsy.

    Altre varianti di progettazione IP JESD204B, tra cui il controllo Nios con L>1, il controllo della macchina a stato RTL, il controllo generico Nios e il controllo generico della macchina a stato RTL non sono interessati da questo problema.

    Soluzione

    Per risolvere questo problema, individuare e eseguire il backup di una copia del seguente file TCL nella directory di installazione di Quartus Prime:

    ip/altera/altera_jesd204/src/lib/phy_adapter/altera_jesd204_phy_adapter_xs_hw.tcl

    • Aprire il file TCL con l'editor di testo. Cercare xseries_avmm_adapter di procedura.

    • Aggiungere $d_L == 1 CONDIZIONE OR controllare l'istruzione if riportata di seguito nella procedura xseries_avmm_adapter. Ci saranno 3 occorrenze delle istruzioni if nella procedura:

    Prima della modifica:

    if {[param_is_true RECONFIG_SHARED]

    Dopo la modifica:

    if {[param_is_true RECONFIG_SHARED || $d_L == 1}

    • Salvare il file TCL modificato.

    • Riavviare il software Quartus Prime, creare un nuovo progetto o riaprire un progetto esistente e generare l'esempio di progettazione Arria 10 JESD204B.

    Questo problema è pianificato per essere risolto in una versione futura del software Quartus Prime.

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