Problema critico
La frequenza di coreclkout
è riportata in modo errato
per l'HARD IP Stratix V per PCI Express IP Core quando l'ATX PLL
viene utilizzato nei dispositivi ES di generazione 1 e gen2. Per le varianti ES di generazione 2, la frequenza
che il software Quartus II segnala coreclkout
è
metà della frequenza effettiva. Per le varianti ES di generazione 1, la frequenza
che i report del software Quartus II per coreclkout sono di un quarto
la frequenza effettiva
Questo problema è risolto nella versione 12.1 del Stratix V Hard IP per CORE IP PCI Express.