ID articolo: 000074567 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 19/03/2019

Esiste un problema noto con il modo in cui il software Intel® Quartus® Prime Pro implementa l'I/O differenziale SSTL e HSTL nei dispositivi Intel Stratix® 10?

Ambiente

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    Sì, a causa di un problema nelle versioni del software Prime Pro Intel® Quartus® 17.0 o successive, gli ingressi SSTL e HSTL differenziali potrebbero non campionare il segnale di input quando implementati su I/O bidirezionale in Intel Stratix® 10 dispositivi se il rispettivo pin VREF non è collegato a un riferimento di tensione. Gli ingressi SSTL e HSTL differenziali non devono richiedere un VREF.

    Soluzione

    Questo problema è pianificato per essere risolto in una versione futura del software Intel Quartus Prime Pro.

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    FPGA e FPGA SoC Intel® Stratix® 10

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