ID articolo: 000074116 Tipo di contenuto: Risoluzione dei problemi Ultima recensione: 05/02/2013

Perché la risoluzione dello spostamento di fase per la megafunzione ALTPLL nella simulazione RTL è diversa dal valore previsto?

Ambiente

  • Intel® Quartus® II (in abbonamento)
  • Simulazione
  • PLL
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    Quando si esegue la simulazione RTL della megafuzione ALTPLL, la risoluzione del passaggio di spostamento di fase potrebbe essere diversa dal valore previsto quando il tipo PLL è impostato su "AUTO" attivando l'opzione Selezionare automaticamente il tipo PLL in ALTPLL MegaWizard® Plug-In Manager. In questo caso, il modello di simulazione può scegliere una frequenza VCO diversa dalla megafunzione ALTPLL e il passaggio di fase non è corretto.

    Questo problema non influisce sulla simulazione a livello di gate utilizzando la megafunzione ALTPLL.

    La risoluzione corretta del passaggio di fase può essere determinata dal calcolo. Fare riferimento a: Phase-Locked Loop (ALTPLL) Megafunction User Guide (PDF), nel capitolo sulla riconfigurazione della fase dinamica. Da questa Guida dell'utente, il passaggio di passaggio di fase più bello è 1/8 della frequenza VCO della PLL.

    Soluzione Per risolvere questo problema, attivare l'opzione Crea file di output utilizzando l'opzione \'Advanced\' PLL parameters nella pagina Input/Lock di ALTPLL MegaWizard Plug-In Manager.

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