ID articolo: 000074027 Tipo di contenuto: Messaggi di errore Ultima recensione: 13/12/2016

Errore:18496 L'output <name> in posizione pin <name> (pad_<number>) è troppo vicino al pin di ingresso del clock PLL (<name>) in posizione pin <name> (pad_<number>)</number></name></name></number></name></name>

Ambiente

  • Intel® Quartus® Prime Standard Edition
  • All

    BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descrizione

    A causa di un problema nel software Quartus® Prime versione 16.0 e precedente, potrebbe essere visualizzato questo errore più in forma quando la progettazione del pacchetto MAX® 10 E144 viene compilata sul sistema operativo Windows con le seguenti condizioni:

    1. Segnale PLL collegato (segnale di clock di ingresso non PLL) al pin di clock di ingresso PLL

    2. Pin di uscita assegnato accanto al pin di clock di ingresso PLL collegato al segnale PLL (segnale di clock di ingresso non PLL)

    Soluzione

    È disponibile una patch per risolvere questo problema nel software Quartus Prime Standard edition versione 16.1. Scaricare e installare la patch 0.01cb dal link appropriato di seguito. Assicurarsi di leggere il leggimi per ulteriori informazioni.

     

    Scaricare la patch 0.01cb per Windows (.exe) del software Quartus Prime Standard versione 16.1

    Scaricare il software Quartus Prime Standard versione 16.1 patch 0.01cb Readme (.txt)

     

    Questo problema è risolto nell'aggiornamento 2 del software Quartus Prime Standard versione 16.1.

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