IP FPGA Intel® Ethernet a tripla velocità
IP FPGA Intel® Ethernet a tripla velocità
Panoramica
Il core IP FPGA Intel® Ethernet a tripla velocità è costituito da un controllo di accesso multimediale (MAC) ethernet da 10/100/1000 Mbps e una proprietà intellettuale (IP) di substrato di codifica fisica (PCS). Questa funzione IP consente a FPGA Intel® d'interfacciarsi a un dispositivo PHY Ethernet esterno, il quale si interfaccia alla rete Ethernet.
Questo IP è offerto in modalità solo MAC o in modalità MAC+PHY. Nella modalità solo MAC, l'IP utilizza un chip PHY esterno per fare il segnalamento. Le due interfacce supportate per le PHY esterne sono: GMII (interfaccia 8 bit a SDR da 125 MHz) e RGMII (interfaccia a 4 bit a DDR da 125 MHz).
Nella modalità MAC+PHY, il PHY è realizzato utilizzando i ricetrasmettitori on-chip o l'I/O LVDS con logica di allineamento di fase dinamica (DPA) che può funzionare fino a 1,25 Gbps. Il protocollo SGMII o 1000Base-X viene utilizzato in questo caso. L'utilizzo di I/O LVDS consente modelli di sistema Ethernet di gigabit multiporta (GbE) molto scalabile risparmiando i ricetrasmettitori seriali per protocolli di prestazioni più elevate.
Caratteristiche
- IP Ethernet da 10/100/1000 completo con tutti i moduli IP necessari
- MAC, PCS e PMA da 10/100/1000 Mbps
- Opzioni IP flessibili
- Solo MAC, solo PCS, MAC + PCS, MAC + PCS + PMA, PCS + PMA
- Molte opzioni per diverse applicazioni e dimensioni piccole come gli elementi logici 900 (piccoli MAC)
- Contatore di statistiche basato su standard che supporta il protocollo di gestione di rete semplice (MIB e MIB-II) e il monitoraggio di rete remoto (RMON)
- Opzioni MAC di FIFO o senza FIFo parametrizzabili
- Opzione di marcatura temporale ad alta precisione e accuratezza IEEE 1588 v2 nell'IP dell'hardware
- Sincronizzazione temporale a un passo e due passi
- Supporta l'incapsulamento di pacchetto PTP IEEE 1588 v2 in IPv4, IPv6 ed Ethernet
- Tempo reale di IP del generatore di clock giornaliero (ToD) nell'esempio di progettazione
- Molte opzioni di interfaccia Ethernet esterne per varie famiglie FPGA Intel®
- MII (10/100 Mbps), GMII, RGMII e SGMII (10/100/1000 Mbps), 1000BASE-X e TBI (1 Gbps)
- I/O di dati di gestione (MDIO) per la gestione del dispositivo PHY esterno
Stato IP
Stato dell'ordine |
Produzione |
Codici di ordinazione |
|
Ethernet a tripla velocità |
IP-TRIETHERNET |
IEEE 1588v2 per Ethernet a tripla velocità |
IP-TRIETHERNETF |
Link correlati
Documentazione
- Progetti di riferimento
- Progettazione di riferimento di FPGA Intel® Stratix® 10
- Progettazione di riferimento di FPGA Intel® Arria® 10 n.1
- Progettazione di riferimento di FPGA Intel® Arria 10 n.2
- Progettazione di riferimento FPGA Stratix® V
- Progettazione di riferimento FPGA Intel® MAX® 10
- AN 440: Accelerare le applicazioni di rete Nios® II (PDF)
- Guida utente IP FPGA Intel Ethernet a tripla velocità (PDF)
† I test misurano le prestazioni dei componenti nell'ambito di un particolare test, in sistemi specifici. Qualsiasi differenza nell'hardware, nel software o nella configurazione potrebbe influire sulle prestazioni effettive. Consulta altre fonti di informazioni per valutare le prestazioni prima di un eventuale acquisto. Per informazioni più complete sulle prestazioni e i risultati dei benchmark, consultare www.intel.com/benchmarks. Intel® e Quartus® sono marchi di Intel Corporation o di società controllate da Intel negli Stati Uniti e/o in altri Paesi.
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