Core IP FPGA Intel® Serial Lite IV

Il core di proprietà intellettuale (IP) FPGA Intel® Serial Lite IV è adatto per una comunicazione di dati ad ampia larghezza di banda per applicazioni chip-to-chip, backplane e board-to-board.

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Core IP FPGA Intel® Serial Lite IV

Il core IP Serial Lite IV include un controllo dell'accesso di media (MAC), il substrato di codifica fisica (PCS) e il blocco di allegato multimediale fisico (PMA). L'IP supporta il trasferimento di dati fino a 58 Gbps per linea, per un massimo di 12 linee PAM4 dei ricetrasmettitori general-purpose (FGT) Intel® Agilex™ F-tile e fino a 116 Gbps, per un massimo di 4 linee PAM4 dei ricetrasmettitori ad alta velocità (FHT) Intel® Agilex™ F-tile in un singolo collegamento o 28 Gbps per linea, per un massimo di 16 linee non-return-to-zero (NRZ) dell'FGT e 58 Gbps per linea per un massimo di 4 linee NRZ dell'FHT. Questo protocollo offre una larghezza di banda, di basso numero di frane overhead, un numero basso di I/O e supporta un'alta scalabilità sia nel numero di linee che nella velocità. L'IP è facilmente riconfigurabile con supporto di una vasta gamma di frequenza di dati con modalità PCS Ethernet del ricetrasmettitore E-Tile e F-Tile.

Questo IP supporta due modalità di trasmissione:

  • Modalità di base: questa è una modalità di streaming pura in cui i dati vengono inviati senza l'avvio di pacchetti, ciclo vuoto e fine di pacchetti per aumentare la larghezza di banda. L'IP assume i primi dati validi come l'avvio di una raffica.
  • Modalità completa: questa è la modalità di trasferimento di dati. Un ciclo di raffica e sincronizzazione è inviato all'avvio e alla fine di un pacchetto come delimitatori.

Caratteristiche

Caratteristica Descrizione
Trasferimento di dati
  • Supporta fino a 116 Gbps per linea per un massimo di 4 linee PAM4 dell'FHT in un singolo collegamento
  • Supporta fino a 58 Gbps per linea per un massimo di 4 linee NRZ dell'FHT in un singolo collegamento.
  • Supporta fino a 58 Gbps per linea per un massimo di 12 linee PAM4 dell'FGT in un singolo collegamento.
  • Supporta fino a 28 Gbps per linea per un massimo di 16 linee NRZ dell'FGT in un singolo collegamento.
  • Supporta modalità di streaming continua (base) o pacchetto (completo).
  • Supporta pacchetti di fotogrammi overhead ridotti.
  • Supporta il trasferimento di granularità di bite per ogni dimensione della raffica.
  • Supporta l'allineamento di linea avviato dall'utente o automatico.
  • Supporta il periodo di allineamento programmabile.
PC
  • Utilizza la logica IP rigida che si interfaccia in modo fluido a un dispositivo Intel® Stratix® 10 e di ricetrasmettitore E-Tile di dispositivo per la riduzione di risorse logiche soft.
  • Supporta la modalità di modulazione PAM4 per le specifiche 100GBASE-KP4. RS-FEC è sempre abilitato in questa modalità di modulazione.
  • Supporta la modalità di modulazione NRZ con il rilevamento di errori e correzione KR-FEC (opzionale).
  • Supporta la codifica-decodifica 64b/66b.
Rilevamento e gestione dell'errore
  • Supporta la verifica di errore di controllo di ridondanza ciclica (CRC), su percorsi di dati di trasmissione (TX) e ricezione (RX).
  • Supporta il controllo di errore di collegamento RX.
  • Supporta il rilevamento di errore PCS RX.
Interfacce
  • Supporta solo il trasferimento di pacchetto full duplex con collegamenti indipendenti.
  • Utilizza l'interconnessione da punto a punto a diversi FPGA con una bassa latenza di trasferimento.
  • Supporta comandi definiti dall'utente.
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Metriche di qualità IP

Livello base

L'IP dell'anno è stato lanciato per primo

2019

Versione più recente del software Intel Quartus Prime supportata

22.2

Stato

Avanzato

Consegnabili

I materiali consegnabili ai clienti includono:

Il file di progettazione (codice fonte crittografato o netlist post-sintesi)

Modello di simulazione per ModelSim*- edizione FPGA Intel

Limiti di tempo e/o layout

Documentazione con controllo della revisione

Sì per tutti

Qualsiasi materiale aggiuntivo consegnabile al cliente fornito con IP

Esempi di prova e design

GUI di parametrizzazione che consente all'utente finale di configurare l'IP

Y

L'IP è abilitato per il supporto della modalità di valutazione IP FPGA Intel

Y

Linguaggio fonte

Verilog

Linguaggio di prova

Verilog

Driver di software forniti

N

Supporto del sistema operativo del driver

N

Implementazione

Interfaccia utente

Avalon Streaming

Metadati IP-XACT

N

Verifica

Supportato dai simulatori

NCSim, ModelSim, VCS/VCSMX

Hardware approvato

Kit di sviluppo FPGA Intel® Agilex™, kit di sviluppo dell'integrità di segnale FPGA Intel® Stratix 10

Test di conformità allo standard di settore eseguito

N

Se sì, quali test?

N/D

Se sì, su quali dispositivi FPGA Intel?

N/D

Se sì, data di esecuzione

N/D

Se no, è in programma?

N

Interoperabilità

L'IP ha eseguito un test di interoperabilità

N/D

Se sì, su quali dispositivi FPGA Intel

N/D

Report di interoperabilità disponibili

N/D
Visualizza tutto Mostra di meno

Risorse aggiuntive

Trova IP

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Supporto tecnico

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Valutazione e acquisto dell'IP

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Suite di base IP

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I-Tested

Intel testa l'interoperabilità e assegna la certificazione I-Tested agli Intel® FPGA IP o ai core IP per membri Design Solutions Network.

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Esempi di progettazione

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