IP FPGA Intel® 10GBASE-R PHY

Il core 10GBASE-R PHY Intel® FPGA Intellectual Property (IP) consente la connettività direttamente con qualsiasi modulo ottico XFP o SFP+ o con qualsiasi dispositivo esterno con interfacce XFI e SFI.

Guida utente Intel® Stratix® 10 L-e H-Tile del ricetrasmettitore PHY

Guida utente del ricetrasmettitore PHY Intel® Arria® 10 ›

Guida utente del ricetrasmettitore PHY Intel® Cyclone® 10 ›

Guida utente del ricetrasmettitore PHY IP core serie V ›

Guida utente delle funzionalità 10-Gbps Ethernet MAC MegaCore

IP FPGA Intel® 10GBASE-R PHY

Il core IP PHY può essere utilizzato sia con un Intel® FPGA IP per MAC Ethernet 10G che con un MAC Ethernet sviluppato dal cliente tramite un'interfaccia XGMII standard a 156,25 Mbps.

Questo core IP PHY è disponibile come parte della funzionalità ricetrasmittente degli FPGA Intel®.

Caratteristiche

  • PHY costituito con un livello di codifica fisica a 10GBASE-R (PCS), 10.3125-Gbps fisiche attachment (PMA) e funzioni di gestione PHY.
  • Interfaccia diretta con MAC 10GbE per una Soluzione completa a chip singolo.
  • PHY integrato nel silicio rigido degli FPGA Intel® Arria® 10, Stratix® V e Arria® V GZ con ricetrasmettitori seriali da 10,3125 Gbps. 10GBASE-R PCS soft è disponibile anche negli FPGA Stratix® IV GT e Arria® V (GT e ST).
  • Connessione seriale diretta a 10.3125 Gbps per chip-to-chip, chip per modulo ottico, chip a dispositivo PHY e applicazioni backplane.
  • Supporto dinamico di I/O (DPRIO) a riconfigurazione parziale nei ricetrasmettitori per adattarsi alle varie caratteristiche del canale 10GBASE-R e ai dispositivi nei sistemi durante il processo.
  • Implementazione delle funzioni standard Ethernet 10GBASE-R PHY: codifica o decodifica 64b/66/, scrambling/descrambling, adattamento del rapporto del dispositivo ricevente per la compensazione della frequenza di sincronizzazione, trasmissione 66b/16b e serializzazione o deserializzazione dei dati da e verso la linea 10.3125 Gbps.
  • Rilevamento dello stato di errore del collegamento del ricevitore
  • Il loopback seriale locale dal trasmettitore al ricevitore al ricetrasmettitore seriale per i test.
  • Opzione IEEE 1588 v2 per la validazione del tempo ad alta precisione e accuratezza.
  • Interfacce di Sistema interno ad alte prestazioni
  • Intel® FPGA Avalon® Streaming (Avalon-ST) single data rate (SDR) XGMII, 72 bit a 156,25 Mbps per il trasferimento dati
  • Intel® FPGA Avalon® Memoria-Mappata (Avalon-MM) 32 bit per la gestione degli slave
  • Conforme allo standard IEEE 802,3 10GbE, articolo 46, 49 e 51.
  • Sono stati superati i test di validazione a 10 Gbps per MAC e PCs effettuati dall'Università del New Hampshire Interoperability lab (UNH-IOL)

Metriche di qualità IP

Livello base

L'IP dell'anno è stato lanciato per primo

2015

Prima versione del software Intel Quartus Prime supportata

16,1

Codici di ordinazione

IP-10GMRPHY: Intel Arria 10

IP-10GBASERPCS: Cyclone® serie V

IP-10GMRPHY: Intel® Cyclone®10

IP-10GETHMAC: 10-Gbps Ethernet MAC MegaCore

Stato

Produzione

Consegnabili

I materiali consegnabili ai clienti includono:

Il file di progettazione (codice fonte crittografato o netlist post-sintesi)

Modello di simulazione per ModelSim*- edizione FPGA Intel

Limiti di tempo e/o layout

Documentazione con controllo della revisione

File Leggimi

Y

Qualsiasi materiale aggiuntivo consegnabile al cliente fornito con IP

GUI di parametrizzazione che consente all'utente finale di configurare l'IP

Y

Il core IP è abilitato per il supporto della modalità di valutazione IP FPGA Intel

Y

Linguaggio fonte

Verilog

Linguaggio di prova

Driver di software forniti

N

Supporto del sistema operativo del driver

Implementazione

Interfaccia utente

XGMII Single Data Rate / GMII / 16 bit GMII (percorso dati), Avalon-MM (gestione)

Metadati IP-XACT

N

Verifica

Supportato dai simulatori

Mentor Graphics*, Synopsys*, Cadence*

Hardware approvato

Intel® Stratix® 10, Intel® Arria® 10

Test di conformità allo standard di settore eseguito

Y

Se sì, quali test?

46, 49, e 51

Se sì, su quali dispositivi FPGA Intel?

Se sì, data di esecuzione

Se no, è in programma?

N

Interoperabilità

L'IP ha eseguito un test di interoperabilità

N

Se sì, su quali dispositivi FPGA Intel

Report di interoperabilità disponibili

N
Visualizza tutto Mostra di meno

Risorse aggiuntive

Trova IP

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Supporto tecnico

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Progettare con Intel® FPGA IP

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Suite di base IP

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I-Tested

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