FPGA Intel® Cyclone® 10 LP

La famiglia FPGA Cyclone® 10 LP di Intel® potenzia la leadership delle serie FPGA Intel® Cyclone® nei dispositivi a bassa potenza. Ideale per funzioni ad alto volume e sensibili ai costi, FPGA Intel® Cyclone® 10 LP è progettato per un'ampia gamma di applicazioni logiche generali.

Vedi anche: Software di progettazione FPGA, Design Store, Download, Community, e Supporto

FPGA Intel® Cyclone® 10 LP

Espansione I/O

Le esigenze di prestazioni sempre più elevate dei sistemi embedded odierne sono determinanti quando si selezionano i microprocessori. La prestazione del processore, oltre che le relative interfacce fisse, spesso influenza la selezione di un processore più grande del necessario al fine di supportare il set di funzionalità I/O richieste dal sistema. Un'alternativa è data dall'uso di un processore ottimale con un FPGA correlato per l'espansione I/O al fine di consentire più funzioni.

Gli FPGA Intel® Cyclone® 10 LP sono perfetti per questo tipo di applicazione in una gamma di blocchi IP, quali I2C, interfacce periferiche seriali (SPI), UART, blocchi I/O paralleli e pacchetti che supportano oltre 500 I/O. Consente al progettista di dimensionare la progettazione in base alle esigenze delle applicazioni, più che a limitare la progettazione di un set di periferiche del processore fisso o ad aumentare il costo del sistema con un processore più grande.

Diagrammi a blocchi del controllo I/O di Intel® Cyclone® LP

Diagramma a blocchi di Intel® Cyclone® LP

Interfacce chip to chip

Gli FPGA Intel® Cyclone® 10 LP sono la soluzione ideale per interfacce tra ASSP. Alcuni esempi sono tra un sensore d'immagine e processori host o tra il processore e uno schermo. In entrambi i casi, l'uso dell'FPGA Intel® Cyclone® 10 LP consente di combinare le interfacce con l'elaborazione di pipeline di'immagini per applicazioni in tempo reale che richiedono velocità di frame elevate, bassa latenza e un alto throughput di elaborazione.

Un esempio di applicazione è dato da un sensore d'immagine CMOS che acquisisce immagini raw e trasmette dati attraverso diversi tipo d'interfaccia: DVP, MIPI CSI o HiSPi a FPGA. L'FPGA è utilizzato per elaborare l'immagine prima di trasmettere i dati al processore host. Un altro esempio di interfacce chip to chip è quando l'FPGA è utilizzato in interfacce tra una fonte video e un LCD. L'elaborazione video dei dati di input delle immagini possono essere necessarie per varie ragioni e può essere implementata usando una suite IP video di Intel per funzioni quali:

Demosaicizzazione e filtro Bayer.
Conversione da un formato di dati a un altro, ad esempio YUV e RGB.
Scala da una dimensione all'altra, ad esempio 1280x720 e 1920x1080.
Codifica/decodifica, filtro, blending, de/interlacciamento, cropping e altro ancora.

Controllo del motore

Gli FPGA Intel® Cyclone® 10 LP offrono flessibilità per interfacce a scopo generico con un numero massimo di utenti I/O di 525. Non solo offre la possibilità di supportare le esigenze di guida dei clienti, ma permette anche di differenziare le loro applicazioni ad alto volume.

Inoltre, facilita l'implementazione e il supporto di una vasta gamma di protocolli industriali Ethernet. Il tessuto FPGA Intel® Cyclone® 10 LP è anche sfruttato per implementare modulatori d'ampiezza d'impulso (PWM) e interfacce di codifica, che, se ripetute più volte in parallelo, permettono il controllo multiasse.

L'algoritmo Field Oriented Control (FOC) di Intel®, insieme al core IP per la soppressione delle vibrazioni implementato sull'FPGA Intel® Cyclone® 10 LP, consente di accelerare le prestazioni e ridurre la latenza. Inoltre, offre la possibilità di scaricare e liberare il processore Nios® II per altre attività.

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Diagramma a blocchi del controllo del motore Intel® Cyclone® LP

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